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3 – Interface Descriptions
Parameters on Core1553BRT
The parameters given in Table 3-1 are used to configure the core.
Table 3-1 ? Core1553BRT Parameters
Parameter
FAMILY
Range
2 to 24
Description
Must be set to the required FPGA family:
8: SX-A
9: RTSX-S
11: Axcelerator
12: RTAX-S
14: ProASIC PLUS
15: ProASIC3
16: ProASIC3E
17: Fusion
18: SmartFusion
19: SmartFusion2
20: IGLOO
21: IGLOOe
22: ProASIC3L
23: IGLOO PLUS
24: IGLOO2
CLKSPD
12, 16, 20, Sets the clock frequency of the core to 12, 16, 20, or 24 MHz
or 24
WRTTSW
WRTCMD
EXTMDATA
0 or 1
0 or 1
0 or 1
When 1, the core will write the transfer status word (TSW) to the
memory.
When 0, the core disables the writing of the transfer status word to
memory.
This is useful for simple RT applications that do not use memory but
have a direct connection to the backend device.
When 1, the core will write the 1553B command word to the locations
used for the TSW values.
If WRTTSW is also enabled, the command word is written to memory at
the start of a message, and the TSW value will overwrite the command
word at the end of the message, unless an external address mapping
function is used.
When 1, the core reads and writes mode code data words from and to
the external memory (except for “transmit last command” and “transmit
BIT [Built-In Test] word”). The VWORD input is not used when this input
is active.
Revision 3
13
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